3.小白学uvm验证

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1.phase机制 uvm 验证环境通过 phase 机制，引入了一套自动化的运行流程，通过该机制我们可以清晰的了解 UVM 仿真阶段的层次化，因为 verilog 中有阻塞和非阻塞赋值，相应的 ...